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| 共 106 篇文章 |
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Allegro 中大型板布局技巧。Orcade原理图导入到allegro PCB后，画好边框就可以通过quickplace 将元件放到边框的四周了。这样导入Allegro后，place时。place-->quickplace-->place by room 选择相应的Room分块放置，局部布局完成后再同样操作进行下一个。也可以通过place-->quickplace-->place by property/value 选择相应的room来... 阅133 转0 评0 公众公开 21-03-23 21:21 |
Cadence 添加room属性。1、在原理图中，选中需要添加room属性的元器件（或页），右键Edit Object properties Filter by:选择Cadence-Allegro，然后找到room区域，赋值，然后Filter by:返回到current properties，就能看到room属性了，然后重新生成网表。回到PCB中，重新导入网表，再画出room区域，setup—outline—room outline,然后在place—... 阅187 转0 评0 公众公开 21-03-23 21:20 |
CAM350导入文件时钻孔文件错误。更改了生成钻孔文件的一个参数，如下。以后在遇到诸如钻孔文件变形，偏移等问题的时候，可以尝试分别导入光绘和钻孔文件的方法，并将其参数设置为和allegro导出时一样的参数，说不定就结局问题了那。比如allegro这边精度是1.100，而cam350这边精度是1.1000 ，这样生成的钻孔文件就出现的精度太低的问题，这个问... 阅254 转0 评0 公众公开 21-03-16 21:20 |
【分享】写了个Allegro导出bom和坐标文件的教程, 仅供参考~e) SYM_NAME, 改成Footprint. 下面的封装如果和JLC的不一样也要改. 比如我用的封装名称都是公制, RESC2012,CAPC1608之类, 要改成相应的英制RESC0805, CAPC0603.没有前缀也可以, 但是在excel可能就变成805/603了, 不影响下单. SOP类的器件最好改成SOIC-8, SOIC-14这样, 等等, 总... 阅1337 转1 评0 公众公开 20-12-01 15:54 |
cadence PCB DIP焊盘助焊层赋值注意事项DIP封装和SMD封装不一样，DIP器件通常采用波峰焊接，它的助焊层在做焊盘时不能赋值，否则在进行回流焊接时焊盘已经上锡了，会堵住过孔。下面看下赋值和不赋值的对比图： 上面两张图分别是DIP过孔焊盘对助焊层赋值和不赋值的对比，严格来说赋值是不对的，会造成钢网刷锡膏时覆盖掉过孔。 阅39 转1 评0 公众公开 20-11-01 21:24 |
【案例分享】Allegro静态铜的避让操作在同学们的印象中，静态铜只能手动编辑形状无法避让线、孔、铜皮或其它障碍物，包括用了多年Allegro的老司机对这点都深信不疑。其实静态铜不仅可以进行避让，而且相对动态铜更灵活，更容易控制，只不过有关它的避让操作都需要手动完成，下面来跟大家科普一下。1.想避让谁就避让谁如下图的静态地铜皮上有其... 阅1827 转3 评0 公众公开 20-10-12 21:10 |
Allegro怎样把活铜变成死铜Allegro怎样把活铜变成死铜，求指导！我试了，选中活铜右键change shape type时，出来一个这个对话框，活铜还是活铜。选是的话，你那个铜皮和焊盘的链接就没有了，你需要重新连接和避让，如果点否的话，应该就可以了。活铜?死铜?行话叫动态铜，静态铜吧，二楼说的方法可试试，静态 和动态 静态就是不会避让，动态你... 阅279 转0 评0 公众公开 20-10-07 21:22 |
怎么给一个过孔设置网络啊？拷贝一个过孔到铜皮上会报错，怎么给这个过孔加上网络啊?1.拷贝相同网络的过孔2.拷贝别的网络过孔时，不要选择retain net of vias.用线连一下.移动一下也可以。.拷贝别的网络过孔时，不要选择retain net of vias.学习了。 阅446 转0 评0 公众公开 20-10-07 21:01 |
重命名网络，以NET01网络为例，用鼠标在网络列表中需要重新命名的NET01网络上点击选择，单击Rename按钮，弹出从命名网络对话框，在Rename net ‘NET01’文本框中输入新建网络名称GND后，点击OK按钮，网络将会被重命名成GND,如下图所示。通过上面的学习让我们看到了Cadence Allegro 17.X手动添加元件与元件引脚添加编辑网络的操作方法利用这个方... 阅2638 转2 评0 公众公开 20-10-02 17:51 |
Allegro 手动添加元件，并且修改元件属性总结在这里也做个总结，因为我的问题是没有导入元件网表的前提下。所以加上的元件显然所呈现出的现象就是J*,正确的方法应该是：1.设置Setup/User Preference/Misc/logic_edit_enable2. 在Logic/Part Logic 选AllgeroPackages或AllgeroComponent,从Database，Lib中选需要的元件，在PartModificiation中... 阅844 转0 评0 公众公开 20-09-27 20:04 |
